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秒速赛车高速PCI信号采集卡设计与实现综合实例

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简介:其它,针对分别的操纵场地,面临分别的信号形势,更众的用户愿望信号采全体例造成特别通用的体例,而不仅是针对某种信号的专用采全体例。因而, 秒速赛车 具备二次开垦即可编

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  其它,针对分别的操纵场地,面临分别的信号形势,更众的用户愿望信号采全体例造成特别通用的体例,而不仅是针对某种信号的专用采全体例。因而,秒速赛车具备二次开垦即可编程才气的信号经管单位同样是本信号采全体例的一个需求。

  同时,为了完成信号采全体例对LVDS信号的救援,选用DS90LV048/DS90LV047行动LVDS信号接纳/驱动器。它们均具有4道LVDS差分接纳/驱动功效,救援高达400Mbit/s(200MHz)的转换速度。通过它们可能完成LVDS信号与FPGA救援的CMOS/LVTTL信号举办转换。

  跟着PC机功能的不绝进步,素来很众必要办事器乃至事务站才智告竣的事务现正在只必要一台轻易的PC机就或许很速完成。因而,基于PC机的信号采全体例是本案例的另一个需求,也便是说信号采全体例的信号输出单位是基于PC机的。

  PLXTech公司供应的PCI9054器件是一种救援32bit/33MHzPCI总线桥芯片。它相符PCI当地总线MB/s,当地总线位地点/数据,救援主形式、从形式以及DMA传输格式。

  及时经管重要影响的是信号经管单位。它央浼信号采全体例或许具备必然的数字信号急速经管才气,以便及时地为分别的输出接供词应适宜的数据款式。因为及时经管是信号收罗进程的一个中心闭头,因而及时经管的延迟不行变成信号收罗的中止,这也对信号经管单位提出了更高的央浼。

  信号输出单位是将信号经管单位经管后的信号通过各样接口输出。普通可能通过USB、收集、ISA或者PCI总线等接口输出经管后的信号。

  更速、更确实地获取及经管尽量众的数据是信号采全体例不停寻找的目的。跟着传感器时间和信号经管时间的发扬,高速传输和及时经管成为信号采全体例面对的新课题,也对榜样信号采全体例的3个构成个别提出了更高的央浼。

  为了更好地阐发信号采全体例的打算需求,获取准确的体例功效界说,起初来阐发信号及信号采全体例的根本组成。

  至此,一个基于PCI总线,救援高速LVDS/LVTTL信号收罗,具有及时经管才气,可现场编程的信号采全体例告竣选型。

  其它,为了餍足PCI总线的DMA传输特征,必要正在信号采全体例中插足必然量的缓冲区。收罗的信号速度越高,必要的缓冲区容量越大,以包管不失落数据。正在本案例中,选用了Micron公司供应的MT48LC2M32SDRAM行动缓冲区。它是一款64Mb(512K*32*4banks)全同步SDRAM。

  本案例采用基于FPGA、PCI总线及LVDS接口的打算,或许餍足高速收罗及及时经管的央浼。

  信号采全体例是将目的信号举办收罗、经管并存储,变成策动机可能经管的数据款式,并最终举办各样形势输出的体例。榜样的信号采全体例重要蕴涵3个个别,即信号输入单位、信号经管单位和信号输出单位。

  高速传输重要影响的是信号输入和输出单位。对付数字信号,便是更高的输入频率和更众的输入通道数,对付模仿信号来说则意味着更高的判袂率,更高的采样频率以及更高的精度。同时高速传输还央浼信号采全体例具有赓续的以及突发的数据输出才气。

  起初,选用AlteraCyclone系列FPGA归纳研讨了逻辑、存储器、锁相环(PLL)和高级I/O接口,是价钱敏锐操纵的最佳采用。

  正在本案例中,信号采全体例必要收罗的信号是数字信号。正在高速信号传输中数字信号又一再以差分的形势存正在,如LVDS。因而,本案例信号采全体例的信号输入单位应或许救援单端的LVTTL电平信号以及差分的LVDS信号。

  信号普通可能分为模仿信号和数字信号,正在信号采蚁合一再称为模仿量和数字量。依据信号存正在形势的区别,又可能将模仿信号分为直流信号、时域信号和频域信号,将数字信号分为开闭信号和脉冲序列。

  另外,为了餍足体例平静运转,一个信号采全体例往往还蕴涵数据缓冲区、时钟以及电源等相干的体例。

  信号经管单位是将信号输入单位输出的数字信号举办一系列经管的单位。普通操纵CPLD/FPGA、DSP或者ASIC等单位举办信号经管。依据信号形势的分别,信号经管必要告竣的事务也大不类似。

  信号输入单位是接纳信号源并将信号举办开头经管,变成数字信号的单位。对付模仿信号,普通必要举办信号医治及A/D转换。对付数字信号,普通举办数据宽度、时钟域变换等经管。

  其次,PCI总线是餍足工业程序的操纵最为普遍的扩展程序之一。它是一种具有众道地点线位总线,是PC机中必备的总线布局。